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520N-MX

HBM2 16GB(最大512GB/s)でメモリ帯域がボトルネックの処理を高速化。Stratix 10 MX搭載

メーカー BittWare BittWare
520N-MX 製品画像
製品名
520N-MX
FPGAメーカー
Altera(Intel)
FPGAシリーズ
Stratix 10
フォームファクター
PCIe
フロントパネル
インターフェース
QSFP28
オンボード
インターフェース
Ethernet、HBM、PCIe Gen3

概要・特長

16GB HBM2を搭載したStratix 10 FPGAボード
メモリバウンドアプリケーションを高速化する強力なソリューション

計算高速化のために設計された520N-MXは、HBM2メモリが統合されたIntelのStratix 10 MX2100 FPGAを搭載したPCIeボードです。
HBM2のサイズと速度(最大512GB / sで16GB)は、メモリバウンドアプリケーションの高速化を可能にします。
ボードの100G QSFP28はクラスタリングに最適であり、OCuLinkコネクタは拡張を可能にします。

従来のHDLとより高い抽象度のC、C ++、及びOpenCLベースのツールフローがサポートされています。
成果物には、Intel OpenCL SDK用の最適化されたボードサポートパッケージ(BSP)が含まれています。

詳細はメーカーサイトをご覧ください。
https://www.bittware-molex.com/ja/fpga/520n-mx/

ブロック図

520N-MX_ブロック図

仕様

■FPGA
  • Intel Stratix 10 MX(F2597パッケージのMX2100)  
    16GBytesオンチップ高帯域幅メモリ(HBM2)DRAM、410 GB/s(スピードグレード2)

■オンボードフラッシュ
  • FPGAを起動するための2Gbitフラッシュメモリ

■外部メモリ
  • デフォルトで16GBモジュールを搭載した288ピンDIMMスロット2個(合計32GB)
      (オプション:合計256GB)
      (オプション:QDR-II +、Intel Optane(3D-Xpoint)DIMM)

■ホストインターフェース
  • FPGAに直接接続されたx16 Gen3インターフェイス

■QSFPケージ
  • 16個のトランシーバーを介してFPGAに直接接続されたフロントパネルの4つのQSFP28ケージ
  • 10/25/40/100GbEをサポートするユーザープログラマブルな低ジッタクロッキング
  • 各QSFP28は独立してクロックすることができます
  • ネットワーク回復クロッキング用のジッタークリーナー
  • 2個のQSFP28で使用可能な100GbE MACハードIP

■OCuLink
  • 2xエッジコネクタ(A、B)@レーンあたり12.5G(デフォルト):
      それぞれPCIe Gen 3 x8ハードIP、GPIO、PCIeマスター、オプションの入力クロックをサポート
  • 2xインナーコネクタ(C、D)@レーンあたり25G(オプション):
      OpenCAPI対応、OCuLinkごとに1x 100GbE MACハードIP

■Board Management Controller(BMC)

■冷却
  • 標準:double-widthアクティブヒートシンク(ファン付き)
  • オプション:double-widthパッシブヒートシンク
  • オプション:double-widthの液体冷却

■電源
  • 12V PCIeスロットと2つのAUXコネクタ(1つの8ピン、1つの6ピン)から得られるオンボード電源

■環境
  • 動作温度:5℃〜35℃

■品質
  • ISO9001:2015 IPC-A-610-Class IIIで製造
  • RoHS対応
  • CE、FCC、ICESの承認

■フォームファクタ
  • Standard-height PCIeデュアルスロットボード
      4.376 x 10.5インチ(111 x 266.7 mm)

提供物

520N-MX FPGAカード
USBケーブル(前面パネルアクセス)
自己診断テスト(BIST)
OpenCL「HPC」ボードサポートパッケージ(BSP)

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