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【AndesCore™ Processors RISC-V Series】 AndesCore™ AX25MP

Linux向け64bit RISC-Vマルチコア。最大4コアのSMP構成、L2キャッシュとコヒーレンシ対応

メーカー Andes Technology Andes Technology
【AndesCore™ Processors RISC-V Series】 AndesCore™ AX25MP 製品画像
製品名
【AndesCore™ Processors RISC-V Series】 AndesCore™ AX25MP
スペシフィケーション
RISC-V CPU
デバイスタイプ
Achronix FPGA、Altera(Intel) FPGA、AMD(Xilinx) FPGA、ASIC、LATTICE FPGA、MICROSEMI FPGA
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概要・特長

AndesCore™ AX25MP 64bitマルチコアCPU IPは、AndeStar™ V5アーキテクチャに基づいています。 RISC-V標準の「IMAC-FD」拡張、Andes Technology社が開発に大きく寄与したDSP / SIMD「P」拡張（ドラフト）、ユーザーレベルの割り込み「N」拡張、高速メモリアクセスや高速ブランチハンドリングなどのAndesパフォーマンス/機能の拡張、およびユーザー定義命令を追加するAndes Custom Extension™（ACE）をサポートします。AX25MPは、LinuxベースのアプリケーションのためのMMU、効率的な分岐命令実行のための分岐予測、level-1命令およびデータキャッシュ、低遅延アクセスのためのローカルメモリを特徴としています。

AX25MP対称型マルチプロセッサは、最大4つのコアと、命令およびデータのプリフェッチを備えたlevel-2キャッシュコントローラーをサポートします。 Andes Coherence Unit（ACU）は、キャッシュレスバスマスターのI / Oコヒーレンスを含むlevel-1キャッシュコヒーレンス、およびスヌープクエリ用に割り当てられた行をスクリーニングするためのL1タグの複製を管理します。その他のAX25MPの機能として、level-1/2メモリのソフトエラー保護用のECC、ベクタへの割り当てと優先度に関する拡張を含むプラットフォームレベル割り込みコントローラー（PLIC: Platform-Level Interrupt Controller）、ソフトウェア品質向上のためのCoDense™ 、StackSafe™ および電源管理用のQuickNap™ 、PowerBrakeが含まれます。

ブロック図

AX25MP

仕様

  • 最大4コアの対称型マルチプロセッサ
  • level-2キャッシュとキャッシュコヒーレンスをサポート
  • AndeStar™ V5 Instruction Set Architecture (ISA)。RISC-V ISA IMACFDNに準拠し、Andesパフォーマンス/機能拡張を含む
  • 浮動小数点拡張
  • デジタル信号処理に最適なDSP/SIMD ISA*カスタマイズと独自命令のために、別ライセンスが可能なAndes Custom Extension™ (ACE)
  • 64-bit CPUアーキテクチャ、4GBを大幅に超えるアドレス空間にアクセス可能
  • コード密度の高い16/32-bit混在のインストラクションフォーマット
  • 制御コードを高速化する分岐予測
  • プロシージャリターン​​を高速化するためのReturn Address Stack（RAS）
  • メモリ管理ユニット（MMU: Memory Management Unit）および物理メモリ保護（PMP: Physical Memory Protection）
  • 幅広いシステムイベントシナリオをサポートするための柔軟に設定可能なプラットフォームレベル割り込みコントローラー（PLIC: Platform-Level Interrupt Controller）
  • リアルタイムパフォーマンスのためのベクトル化された割り込み処理の強化
  • プログラムコードサイズ削減に寄与できるAdvanced CoDense™ テクノロジー

提供物

RTLソースコード

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