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GDDRメモリコントローラIP・PHY IP

AI/ML・HPC向けASIC用GDDR6コントローラとPHY。最大24Gbps/pin、デュアルチャネル対応

メーカー Rambus Rambus
GDDRメモリコントローラIP・PHY IP 製品画像
製品名
GDDRメモリコントローラIP・PHY IP
スペシフィケーション
DDR
デバイスタイプ
ASIC

概要・特徴

GDDR6 コントローラ、PHY、メモリ インターフェイス サブシステムは、AI/ML、グラフィックス、HPC アプリケーション向けに高帯域幅、低レイテンシのメモリ性能を提供します。

ブロック図ファイル名

GDDR6-Memory-Interface-Subsystem-Example

仕様

完全なGDDR6メモリ・サブシステム・ソリューション
GDDR は元々グラフィックス・アプリケーション用に設計されたものですが、様々な計算集約型アプリケーションで使用できる高性能メモリ・ソリューションです。

RambusのGDDR6コントローラは、ラムバスGDDR6 PHYの帯域幅とデュアルチャネル機能を完全にサポートしています。また、Look-Aheadコマンド処理により、メモリ帯域幅を最大化し、レイテンシを最小化します。コアはDFI互換(GDDR6用の拡張機能付き)で、ユーザーロジックへのAXIまたはネイティブインターフェイスをサポートします。

詳細は、メーカーサイトを参照ください。
https://www.rambus.com/interface-ip/gddr/

提供物 (fittings)

コントローラ

  • コントローラ(ソースコード)
  • テストベンチ(ソースコード)
  • ドキュメント

PHY

  • 特性化されたハードマクロ(GDSII)
  • ゲートレベルおよびIOモデル
  • Verilogビヘイビアモデル
  • レイアウト・アブストラクト (.lef)
  • タイミングモデル (.lib)
  • CDLネットリスト (.cdl)
  • GDSIIレイアウト
  • DRCおよびLVSレポート
  • ドキュメント
  • データシート
  • パッケージ設計ガイドライン
  • ASIC/DFT製造ガイドライン
  • テストおよび特性評価ユーザーガイド
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