IPC500は、Chip on FPGAのIPC9xxx、IPC17xxおよびIPC1603の評価のためキットです。
IPC9xxx、IPC17xxおよびIPC1603は、パケット網上に高品質周波数同期および時刻（ToD）を提供するために、IPClockの最高水準の技術によって最適化されたIEEE 1588v2準拠のバウンダリー、マスターおよびスレーブクロックを利用しています。
IPC9xxx、IPC17xxおよびIPC1603は、Xilinx社のSpartan6 FPGAにChip on FPGAとして実装されており、8MBのフラッシュメモリおよび64MBのDDR IIメモリを使用しています。
IPC500は、BNCコネクタ経由でCLK IN、CLK OUTおよびPPS、RJ45を経由して100/1000Mbpsのイーサネット接続、DB9コネクタを経由してRS232 TODインタフェースを持っています。
IPC500は、RS232管理ポートを経由してユーザによって監視することができます。またIPC500は、いくつかのLEDによって次の状態表示をします。システム電力、デバイス状態（パス、アラーム、フェール）、クロック状態（フリーラン、ホールドオーバー、トレース/ロック）。
①IPC500ボード
②付属品
③ドキュメント
・IPC500 EVB Datasheet
・IPC500 User Manual
・IPC500 Schematics
・IPC500 Schematics - Application Note
以下のドキュメントはIPClock社とのMutual NDA締結によって提供可能です。
・IPC9xxx_17xx_1603 User Guide
・IPC9000 Datasheet
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