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セキュリティネットワーク

IPsec、TLS、SSL向けマルチプロトコルエンジン

IPsec・TLS・MACsecなどをまとめて処理するパケットエンジン。100Mbps～100Gbps、1～16エンジン構成

メーカー Rambus Rambus
IPsec、TLS、SSL向けマルチプロトコルエンジン 製品画像
製品名
IPsec、TLS、SSL向けマルチプロトコルエンジン
スペシフィケーション
IPsec
デバイスタイプ
ASIC
Rambus製汎用IP一覧はこちら 汎用IP製品一覧はこちら IPsecの汎用IP製品一覧はこちら ASICの汎用IP製品一覧はこちら

概要・特長

完全にプロトコルを把握しているインテリジェントなパケットエンジンにより、トランザクションのスループット向上、CPUのオフロードを実現します。マルチプロトコルエンジンは、IPsec、MACsec、SSL/TLS/DTLS、sRTP、並びに基本ハッシュと暗号実行を、100Mbpsから100Gbpsの範囲で処理します。アーキテクチャは、伝統的なルックアサイドエンジンと、より高度かつ強力なインラインパケットエンジンの双方をサポートしております。

多様なコンフィグレーションに対応致します。

  • 1個から16個の処理エンジン
  • 基本構成：IPsec, TLS, SSL, MACsec, AES, (3)DES, SHA-1, SHA-2, MD5
  • オプション構成：
    - ARC4 + SHA-384 + SHA-512
    - Kasumi + SNOW3G + ZUC
    - Extended IPsec
    - Extended SSL
    - AES-XTS
    - SHA3-224 + SHA3-256 + SHA3-384 + SHA3-512
    - ChaCha20 + Poly1305
  • ゲート数：1 to 7.5k gates
  • スピード：Up to 1150 MHz
  • 処理能力：Up to 64 bits/clk

ブロック図

IPsec、TLS、SSL向けマルチプロトコルエンジン

仕様

IPsec Classification:

  • IPv4/IPv6 and IPsec-ESP header parsing to look-up a flow or transform,
  • Fetch flow and/or corresponding transform record based on lookup result,
  • Optionally update flow statistics,
  • Optionally update transform statistics,
    • For details on the supported L2, L3 and L4 header parsing is referred to the Firmware Reference Manual.

IPsec transformation:

  • Full IPsec packet ESP transforms according to both legacy IPsec v2 (240x) and latest IPsec v3 (430x) RFC’s as well as all relevant cipher suite RFC’s,
  • Autonomous IPsec ESP packet classification and Security Association selection (both in- and outbound),
  • IPsec ESP tunnel & transport modes,
  • Complete IPsec Header/Trailer processing,
  • Insert ESP header for outbound packets, strip and verify ESP header for inbound packets,
  • Full sequence number processing, including ESN and full anti-replay check with various mask sizes, up to 384 bits
  • Calculate and insert Integrity Check Value for outbound packets, strip and verify for inbound packets,
  • Append (outbound) / strip and verify (inbound) padding up to 255 bytes.
  • Support for processing packets for one SA on multiple processing engines, maintaining SA coherency.

SSLv3.0 / TLSv1.0 / TLSv1.1 / TLSv1.2 / TLSv1.3:

  • Packet transforms according to all relevant RFCs,
  • Header processing,
  • Full autonomous single pass processing for stream and block cipher modes of operation,
  • Padding insertion & removal up to 255 bytes,
  • ICV/TAG insertion/verification.

DTLS v1.0 / DTLS v1.2 / DTLS v1.3

  • Packet transforms according to all relevant RFC’s,
  • Header processing,
  • Full autonomous single pass processing for stream and block cipher modes of operation,
  • Padding insertion & removal up to 255 bytes,
  • ICV/TAG insertion/verification.
  • Support for processing packets for one SA on multiple processing engines, maintaining SA coherency.

MACsec

  • MACsec frame transforms according to IEEE 802.1AE-2006 and 802.1AEbn,
  • SecTAG insertion and removal,
  • PN insertion, removal and verification,
  • ICV generation, insertion, removal and verification.
  • Support for processing packets for one SA on multiple processing engines, maintaining SA coherency.

SRTP

  • SRTP packet transforms according to RFC3711,
  • ROC insertion and removal,
  • MKI insertion and removal,
  • TAG generation and insertion.

Wireless Algorithms

  • Kasumi f8 and f9,
  • SNOW 3G,
  • ZUC.

Storage algorithms

  • AES-XTS (ANSI/IEEE Std P1619-2007),

対応デバイス、対応OS

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ロジックリソース

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ライセンス形態

ライセンスの詳細についてはお問い合わせください。

評価版

評価用ライブラリをご提供致します。詳しくはお問合せください。

提供物

ドキュメント

  • Hardware Reference and Programmer Manual
  • Integration Manual
  • Verification Specification
  • Programmer and Operations Manual
  • Firmware Reference Manual

論理合成可能なVerilog RTLソースコード
RTLテストベンチ（テストベクタ、期待値ベクタ含む）
シミュレーションスクリプト

メーカーWEBサイト

https://www.rambus.com/security/protocol-engines/multi-protocol-engines/

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