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LVDS/D-PHY Combo Transmitter

MIPI D-PHYとLVDSを切り替えて送信できるASIC用コンボトランスミッタ。D-PHYは1.05Gbps/レーン×4

メーカー Mixel Mixel
LVDS/D-PHY Combo Transmitter 製品画像
製品名
LVDS/D-PHY Combo Transmitter
スペシフィケーション
MIPI C-PHY/D-PHY
デバイスタイプ
ASIC

概要・特長

MXL-LVDS-DPHY-DSI-TXは高周波数、低消費電力、ローコスト、ソースシンクロナスを特長とし、MIPIアライアンス規格であるD-PHYをサポートし、デジタルCMOSテクノロジーで実装された高性能4チャンネルLVDSシリアライザです。

LVDSモードでは、シリアルとパラレルデータはそれぞれ4チャンネルに分けられます。パラレルデータは1チャンネルにつき7ビットのデータ幅を持ちます。入力クロック周波数は25MHz~150MHz。シリアライザはモジュール設計によりプロセスマイグレーションがしやすく、外付けのコンポーネントも必要としません。

仕様

D-PHYについて:

  • 1つのクロックと4つのデータレーン
  • 規格MIPI 1.1のD-PHYに対応
  • 高速と低速モードの両方に対応
  • 高速モードでは80 Mbps~1.05Gbps/レーン
  • 低消費電力モードでは10 Mbps/レーン
  • 高速シリアライザが含まれる
  • 終端抵抗キャリブレーションは選択可

LVDSについて:

  • 24~150MHzのクロック周波数をサポート
  • バンド幅は最大で1050Mbps/チャンネル
  • 最大スループットは4.2 Gbps
  • 低消費電力のCMOS設計
  • PLLs内蔵
  • クロックごと7ビット/チャンネルのシリアルデータ転送
  • データストローブは立ち上がり/立下りの選択可
  • TIA/EIA-644 LVDS Standardに準拠

製品構成

ロジックリソース

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提供物

  • 仕様書
  • GDSII
  • LVSネットリスト
  • LEFファイル
  • Verilogモデル
  • Timingモデル
  • 実装ガイドライン
  • RTL
  • ドキュメント

ライセンス形態

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