プログラマブル ペリフェラル インターフェース 【D8255】

プログラマブル ペリフェラル インターフェース 【D8255】

概要・特長

D8255は、すべてのインテルCPUで使用できるように設計されたプログラマブルI/Oです。 他のほとんどのマイクロプロセッサーもサポートしています。 24のI/Oピンを備えており、12の2つのグループを個別にプログラムでき、3つの動作モードで使用できます。


● 業界標準の8255と互換性があります

● 24のI/Oラインが12の2つのグループに個別にプログラムできます
  • グループA - ポートAとポートCの上半分
  • グループB - ポートBとポートCの下半分

● 3つの主要な動作モード

  • モード0 - 基本入出力
  • モード1 - ストローブ入力/出力
  • モード2 - 双方向バス
  • コントロールワードリードバック機能
  • ダイレクトビットセット/リセット機能
  • 割り込み制御機能

仕様

シンボル

ブロックダイアグラム

ピン説明

ユニット

Data Bus Buffer
データバスバッファは、D8255とシステムデータバスとのインタフェースに使用されます。 データは、CPUによって入力または出力命令の実行時にバッファによって送信または受信されます。 コントロールワードおよびステータス情報もデータバスバッファを通して転送されます。
Read/Write and Control Logic
コントロールロジックブロックは、データワード、コントロールワード、ステータスワードの内部および外部転送を管理します。 これは、CPUアドレスバスとコントロールバスからの入力を受け取り、順番にAとBのコントロールグループにコマンドを発行します。
Ports A, B, and C
D8255には3つの8ビットポートがあります。ソフトウェアによって多様な構成をとれます。
Port A
1つの8ビットデータ出力ラッチ/バッファと1つの8ビット入力ラッチバッファです。「プルアップ」と「プルダウン」で保持できます。
Port B
1つの8ビットデータ入出力ラッチ/バッファです。ポートBは「プルアップ」で保持できます。
Port C
1つの8ビットデータ出力ラッチ/バッファと1つの8ビットデータ入力バッファ(入力ラッチなし)です。このポートは、モード制御で2つの4ビットポートに分割できます。 各4ビット・ポートには4ビット・ラッチが含まれており、制御信号出力およびステータス信号入力にポートAおよびBと共に使用できます。Port Cは「プルアップ」で保持できます。
Group A and Group B Controls
各ポートはシステムソフトウェアによってプログラムします。、CPUはD8255にコントロールワードを「出力」します。コントロールワードには、D8255の機能構成を初期化する「モード」、「ビットセット」、「ビットリセット」などの情報が含まれています。コントロールブロック(グループAおよびグループB)の各々は、読み出し/書き込みコントロールロジックからの「コマンド」を受け取り、内部データバスから「コントロールワード」を受け取り、関連するポートに適切なコマンドを発行します。
 グループA - ポートAとポートCの上半分
 グループB - ポートBとポートCの下半分
コントロールワードレジスタは、書き込みと読み出しが可能です。

対応デバイス、対応OS

  • Intel FPGA
  • Lattice FPGA
  • Xilinx FPGA
  • ASIC

ロジックリソース

提供物

Source code
・VHDLソースコード
・VERILOGソースコード
・ネットリスト(FPGA EDIF / NGO / NGD / QXP / VQM)
VHDL&VERILOGテストベンチ環境
・Active-HDL自動シミュレーションマクロ
・ModelSim自動シミュレーションマクロ
・リファレンス レスポンスによるテスト
技術文書
・インストールに関する注意事項
・HDLコア仕様
・データシート
合成スクリプト
サンプルアプリケーション
テクニカルサポート
・IPコア実装のサポート
・3ヶ月のメンテナンス
 IPコアの提供とドキュメントのアップデート、マイナーバージョンとメジャーバージョン
 の変更
 メールサポート

ライセンス形態

  • プロジェクト限定ライセンス
  • ロイヤリティ フリー
  • シングルサイト/マルチサイトを選択(開発拠点数)

評価版

利用期間1ヶ月の無償評価版

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