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ネットワーク

IPC1603

基地局などの周波数・時刻同期に。IEEE 1588v2スレーブ専用、Spartan-6実装のChip on FPGA

メーカー IPCLOCK IPCLOCK
IPC1603 製品画像
製品名
IPC1603
スペシフィケーション
Clock Generator
デバイスタイプ
Altera(Intel) FPGA、AMD(Xilinx) FPGA、ASIC

概要・特長

IPC1603は、パケット交換ネットワーク上で高品質の周波数同期とTime of Day(ToD)を提供するために最適化されたIEEE 1588 v2用のIPClockの最先端技術を利用しています。クロック同期は多くのアプリケーションで必要です。

例えば、UMTS(Universal Mobile Telecommunications Systemの周波数分割複信(FDD)では、周波数の同期が必要であり、LTEは周波数同期、位相アライメント、ToD(Time of Day)を必要とします。IPC1603はXilinx Spartan®-6 FPGAを利用したFPGA、16MBのフラッシュメモリと64MBのDDR IIメモリをサポートしています。

IPC1603は、高い同期レベルを必要とするアプリケーションを実現するために設計された、アプリケーションにとらわれず、費用対効果が高く、信頼性が高く、標準に準拠したIEEE 1588 v2スレーブです。

IPC1603は将来の拡張機能や将来のクロック同期規格をサポートするためのフィールドアップグレードを容易にするように設計されています。

ブロック図

IPC1603ブロック図

仕様

  • 単独で動作する IEEE 1588 v2準拠のスレーブ Chip on FPGA
  • 最も極端なパケットトランスポートネットワーク状態上で優れた同期性能を実現
  • スレーブ 3G/4G-LTE/5G の周波数とToD精度に適合
  • ネットワーク障害に適応
  • 典型的なロック時間 10秒以下
  • スレーブToDエラー誤差:ITU-T G.8261の条件下で管理される10スイッチGbEネットワーク環境において±1μsec以内
  • スレーブ周波数精度の性能:ITU-T G.8261の条件下で管理される 10スイッチGbEネットワーク環境において16ppb以上
  • GMIIインタフェース
  • 精密なホールドオーバーを提供
  • ハイブリッド 1588/SyncE モード対応(外部SyncE PLL必要)
  • APTS (Assisted Partial Timing Support)対応
  • IEEE1588プロファイル:G.8265.1, G.8275.1, G.8275.2
  • 64スレーブ/チャンネル対応
  • ユニキャスト/マルチキャスト対応
  • One stepオペレーション/Two stepオペレーション対応
  • 低トータルコストを実現
  • 外部CPUの介在不要
  • 将来の時間同期規格に対応、容易な機能強化追加
  • TCXOまたはOCXO で動作(10MHz, 12.8MHz or 20MHz)
  • 一般的なPHYインターフェース対応
  • 動作モード:Free run, Trace, Lock and Holdover

対応デバイス、対応OS

Xilinx Spartan®-6 FPGA - XC6SLX45
(324 pin BGA, 15 mm x 15 mm,0.8 mm pitch RoHS package)

※上記FPGAはXilinx代理店様から購入していただきます。

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