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ペリフェラル

I2Cインターフェース マスター【DI2CM-FIFO】

I2C v6.0準拠のマスター。最大5Mb/sのウルトラファースト対応、FIFOは最大256バイト

メーカー Digital Core Design Digital Core Design
I2Cインターフェース マスター【DI2CM-FIFO】 製品画像
製品名
I2Cインターフェース マスター【DI2CM-FIFO】
スペシフィケーション
I2C
デバイスタイプ
Achronix FPGA、Altera(Intel) FPGA、AMD(Xilinx) FPGA、ASIC、LATTICE FPGA、MICROSEMI FPGA
Digital Core Design製MCU IP一覧はこちら MCU IP製品一覧はこちら I2CのMCU IP製品一覧はこちら Achronix FPGAのMCU IP製品一覧はこちら Altera(Intel) FPGAのMCU IP製品一覧はこちら AMD(Xilinx) FPGAのMCU IP製品一覧はこちら

概要・特長

I2Cは、2線式の双方向シリアルバスであり、デバイス間のデータ伝送のシンプルで効率的な方法を提供します。I2Cインターフェース マスターは、マイクロプロセッサ/マイクロコントローラとI2Cバス間のインタフェースを提供します。マイクロプロセッサ/マイクロコントローラによって決定される動作モードに応じて、マスタとして動作します。DI2CMコアには I2C仕様 v.6.0のすべての機能が組み込まれています。

仕様

  • I2C仕様のv.6.0に準拠
  • マスター動作
    マスタートランスミッタ
    マスターレシーバー
  • すべての伝送速度のサポート
    スタンダード（最大100kb/s）
    ファスト（最大400kb/s）
    ファストプラス（最大1Mb/s）
    ハイスピード（最大3,4 Mb/s）
    ウルトラファースト（最大5 Mb/s）
  • 最大256バイトのFIFOを設定可能
  • SDA / SCLグリッチフィルターを設定可能
  • ソフトウェアプログラマブルなSDA / SCLバスタイミング
  • アービトレーションとクロック同期
  • マルチマスターシステムをサポート
  • I2Cバスの7ビットおよび10ビットのアドレス指定フォーマットのサポート
  • 割り込み生成
  • 幅広い入力クロック周波数からの動作が可能（12ビットクロックタイマー内蔵）
  • 標準バスインターフェイス（AMBA - APB Bus、Altera Avalon Bus、Xilinx OPB Bus）をサポート

対応デバイス、対応OS

ASIC、および、FPGA

ロジックリソース

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提供物

  • VERILOG または VHDLソースコード、または、FPGAネットリスト
  • VHDL またはVERILOGテストベンチ環境
  • 技術文書
    • インストールに関する注意事項
    • HDLコア仕様
    • データシート
  • 合成スクリプト
  • サンプルアプリケーション
  • テクニカルサポート

ライセンス形態

シングルプロジェクトライセンス (ロイヤリティなし)

評価版

あり

  • ネットリスト提供
  • 利用期間1ヶ月間

製品カタログ

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