UART 【D16950】

• 16450、16550、16650、16750、および16950 UARTと互換性のあるソフトウェア
• コンフィギュレーション機能
• 構成可能なBAUDクロックラインを分離
• 多数決ロジック
• RS232およびRS485をサポート
• 2つの動作モード：UARTモードとFIFOモード
  • FIFOモードでは、トランスミッタとレシーバはそれぞれ128（最大512）バイトのFIFOでバッファされ、CPUに通知する割り込み数を減らします
  • UARTモードでは、CPUとシリアルデータ間の正確な同期の必要性を排除するために、
    レシーバとトランスミッタがダブルバッファされています
• 受信方向と送信方向の両方で 256、512バイトへのFIFOに拡張可能
• シリアルデータに標準の非同期通信ビット（スタート、ストップ、パリティ）の追加または削除
• 独立して制御された送信、受信、ラインステータス、データセット割り込み
• 誤りスタートビット検出
• 16ビットプログラマブル ボー・ジェネレータ
• 独立したレシーバクロック入力
• モデム制御機能（CTS、RTS、DSR、DTR、RI、DCD）
• RTSおよびCTSによるプログラム可能なハードウェアフロー制御
• DTRとDSRを使用したプログラム可能なフロー制御
• XON / XOFFを使用したプログラム可能なインバンドフロー制御
• プログラム可能な特殊文字の検出
• 割り込みと自動インバンドおよびアウトオフバンドフロー制御
• 完全にプログラム可能なシリアルインタフェース特性：
  • 5ビット、6ビット、7ビット、8ビット、9ビットキャラクタ
  • 偶数、奇数、パリティなしのビット生成および検出
  • 1、1と1/2、2ストップビットの生成
  • 内部ボー・ジェネレータ
  • 受信FIFOでの不良データの検出
• 1から31,875までのクロック分周回路
• 強化された同期クロックオプション
• 9ビットデータモード
• ソフトウェアリセット
• 完全なステータスレポート機能
• ラインブレークの生成と検出。内部診断機能：
  • Communications Link Fault Isolationのためのループバック制御
  • ブレーク、パリティ、オーバーラン、フレーミングエラーシミュレーション
• 優先割り込みシステム制御
• システムインターフェースラッパー
  • AMBA - APB Bus、Altera Avalon Bus、Xilinx OPB Bus

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• 利用期間30日間

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