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USB3.0/2.0デバイスIPコア

USB3.0/2.0デバイスIPコア

概要・特長

USB3.0周辺機器(USB3.0デバイス)設計に使用可能なIPコア

  • インテル・ザイリンクス社FPGA搭載システムに手軽にUSB3.0機能を追加可能
  • USB3.0/USB2.0両仕様に対応したリンク層・プロトコル層を提供

高性能・少リソースを両立

  • 転送性能460MByte/秒以上・非圧縮フルHD1080/60p RGB動画伝送可能
  • 【8エンドポイント構成時のゲート規模】
    インテルの場合 29.8KLE
    ザイリンクスFPGAの場合 28.8KLUT

低コストFPGAを使った設計が可能

  • CycloneおよびSpartan、AritixクラスのFPGAで動作可能

仕様

USB3.0/2.0 IPコア仕様
  • USB3.0仕様 Rev.1.0(SS 5Gbps対応)・USB仕様Rev.2.0(HS480Mbps対応)に準拠
  • PHY Interface For the USB3.0 Architectures Version3.0(PIPE 3.0)に準拠
  • エンドポイント数は1~16まで、コンフィグレーションによりカスタマイズ可能、バルクイン/アウト転送(最大16バースト)・インタラプトイン/アウト転送

システムインタフェース仕様
  • インテル版:Avalon® Memory-Mapped(Avalon-MM)に準拠・データバス幅64Bit(マスタ)/32Bit(スレーブ)
  • ザイリンクス版:AXI/APB準拠・データバス幅64Bit(マスタ)/32Bit(スレーブ)
  • Endpoint毎に高性能DMA機能を搭載

部品構成

対応デバイス

  • インテルFPGA
  • ザイリンクスFPGA

ロジックリソース

提供物

  • IPコア ネットリスト
  • ハードウェアマニュアル
  • サンプルソフトウェア

ライセンス形態

プロジェクト限定
以下台数にて選択
  • 300台未満
  • 1,000台未満
  • 3,000台未満
  • 3,000台以上

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