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検索結果：未定義
未定義 IP（IPコア/FPGA/ASIC）
Mixel
D-PHYは、複数ファンダリでのシリコン実績を持つ。アーキテクチャは自社の高性能PLLsに最適化されており、最高で2.5GbpsのMIPIアプリケーションに対応。
MXL-CPHY-DPHYは高周波、低消費電力、ローコストが特徴で、コンフィグレーションによってC-PHYかD-PHYとなり、トランスミッタかシーバーとして動作する。D-PHYモードでは、CSI-2 v1.2それにDSI v1.3をサポートするMIPIマスターかスレーブに設定することが可能。
MXL4254Aは、シリコン実績を持つクワッドギガビットSerDesで、4チェンネルは全て最大で4.25Gbpsのデータレートをサポート。
MXL-DS-LVDSは、高性能4チャンネルLVDSデシリアライザで、シリアル/パラレルデータは共に4チャンネル構成。チャンネルごとのパラレルデータのビット幅は7か10ビット。入力クロック周波数は25MHz～165MHz。
MACNICA
1レーンあたりの最大伝送帯域は4Gbpsを実現。
USB 3 Vision Standard Version 1.01に対応。USB 3.0を活かした高速データ転送が可能。
Intel（インテル）FPGAでHDMI2.0規格に準拠した送信および受信を実現。
CC-Link IE Field、インテリジェントデバイス局に対応。
Hardent
最大3倍の視覚的にロスレスな映像圧縮を実現するデコーダIP
最大3倍の視覚的にロスレスな映像圧縮を実現するザイリンクスFPGA向けデコーダIP
VDC-M(VESA Display Compression-M 1.2に完全に準拠したデコーダ
HDMI 2.1仕様で指定されているリードソロモンFECおよびシンボルマッピング/インターリーブを実装
HDMI 2.1仕様で指定されているリードソロモンFECおよびシンボルデインターリーブ/デマッピングを実装
HardentのDisplayPort 1.4 IPは、同じ物理リンク速度を使用しながら、DisplayPortデータ転送容量を3倍に増やす視覚的にロスレスな映像圧縮技術であるVESA DSC 1.2aをサポートしています。
VESA DisplayPort 1.4仕様で指定されているように、リードソロモンFECとシンボルインターリーブを実装
VDC-M(VESA Display Compression-M 1.2に完全に準拠したエンコーダ
最大3倍の視覚的にロスレスな映像圧縮を実現するザイリンクスFPGA向けエンコーダIP
最大3倍の視覚的にロスレスな映像圧縮を実現するエンコーダIP
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