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IP(インターフェース)
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検索結果："IP(インターフェース)"
IP（IPコア/FPGA/ASIC）, IP(インターフェース), [ オートモーティブ ]
Digital Core Design
CANバスコントローラは、自動車および産業用アプリケーションで広く使用されているコントローラエリアネットワーク（CAN）のスタンドアロンコントローラです。 Bosch CAN 2.0B仕様（2.0B Active）およびCAN FDに準拠しています。
IP（IPコア/FPGA/ASIC）, IP(インターフェース), [ イメージセンサー ]
NORTHWEST LOGIC
MIPI（Mobile Industry Processor Interface)向けIPは、CSI(Camera Serial Interface)-2、DSI(Display Serial Interface)-2/DSI（Display Serial Interface）の規格上の最高データレートをサポートし、MIPI(Mobile Industry Processor Interface)テストベンチもご提供します。
MACNICA
SLVS-EC Specification Version 1.2対応。
IP（IPコア/FPGA/ASIC）, IP(インターフェース), [ HPC ]
PCIe向けIPは、PCIe規格に準拠し、PCI-SIGによって認証済みのIPコアをご提供します。シリコン実績を持ち、PCIeとDMAを完全にサポートし、PIPE準拠のPHYであれば全て対応します。
IP（IPコア/FPGA/ASIC）, IP(インターフェース), [ AI ]
Rambus
HBM3は、消費電力の低減と小型化を特徴とする高性能メモリです。2.5Dパッケージングとより広いインターフェイスを低クロックで（GDDR6と比較して）組み合わせることで、AI/MLやハイパフォーマンス・コンピューティング（HPC）アプリケーション向けに、高いバンド幅/ワット効率で全体的なスループットを向上させます。
ラムバス社のPCI Express（PCIe）5.0およびCompute Express Link（CXL）2.0 PHYは、柔軟性と統合のしやすさを最大限に高めるために、システム指向のアプローチで設計された、低消費電力でエリアに最適化されたシリコンIPコアです。
IP（IPコア/FPGA/ASIC）, IP(インターフェース), IP(画像処理), [ 画像処理 ]
DisplayPort™ 1.4 および HDMI® 2.1 FEC IP コアは、エンドユーザーにグリッチのない視覚体験を提供するとともに、設計者が VESA® Display Stream Compression (DSC) を使用してより高い解像度およびリフレッシュレートに到達できるようにします。
VESA® Display Stream Compression (DSC) および VDC-M エンコーダ/デコーダ IP コアは、視覚的にロスレスなビデオ圧縮性能を実現し、高解像度、高速リフレッシュレート、高ピクセル深度を持つ最先端ディスプレイの帯域幅要件の増大に対応することができます。
IP（IPコア/FPGA/ASIC）, IP(インターフェース), IP(画像処理), [ 映像配信 ]
シリコンで実証された高性能なMIPI® CSI-2®およびDSI-2SMコントローラコアは、SoC、ASIC、FPGAでの使用向けに最適化されています。利用可能なMIPIテストベンチは、MIPI設計のエンドツーエンド・シミュレーションの機能を提供します。
IP（IPコア/FPGA/ASIC）, IP(インターフェース), IP(画像処理), [ イメージセンサー ]
IP（IPコア/FPGA/ASIC）, IP(インターフェース), IP(メモリ), [ 画像処理 ]
High-Bandwidth Memory (HBM) 3.0および2E/2コントローラ、PHY、メモリインターフェースサブシステムは、AI/ML、グラフィックス、HPCアプリケーション向けに広帯域、低レイテンシのメモリ性能を提供します。
IP（IPコア/FPGA/ASIC）, IP(インターフェース), IP(メモリ), [ データセンター ]
GDDR6 コントローラ、PHY、メモリ インターフェイス サブシステムは、AI/ML、グラフィックス、HPC アプリケーション向けに高帯域幅、低レイテンシのメモリ性能を提供します。
LPDDR5/5X および LPDDR4/4X デジタルコントローラは、モバイル、車載、IoT 、エッジネットワーク機器などの低電力アプリケーション向けに高いメモリ帯域幅とスループットを実現します。
DDR4およびDDR3コントローラ、PHY、メモリインターフェースサブシステムは、DDR4およびDDR3の業界標準と完全な互換性を提供しながら、高帯域幅と電力効率を実現しています。
IP（IPコア/FPGA/ASIC）, IP(インターフェース), IP(メモリ), [ HPC ]
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