PCI Express IP

概要・特徴

シリコンで実証された高性能PCI Express^® (PCIe^®) 6.0, 5.0, 4.0 およびそれ以前の世代のデジタルコントローラ、PHY、インターコネクトサブシステム一式は、SoC、ASIC、FPGAでの使用に最適化されています。これらの高性能インターフェイスの市場をリードするソリューションは、AI/ML、データセンター、エッジアプリケーションに対応しています。

ブロック図ファイル名

仕様

詳細は、メーカーサイトを参照ください。
https://www.rambus.com/interface-ip/pci-express/

提供物 (fittings)

コントローラIP

• Verilog RTL（ソースコード）
• 機能シミュレーション用ライブラリ
• コンフィギュレーション・アシスタントGUI（Wizard）
• PCIeバス機能モデル
• リファレンス・デザイン
• ドキュメント

PHY IP

• Verilogモデル
• LEFアブストラクト (.lef)
• タイミングモデル (.lib)
• CDLネットリスト (.cdl)
• ATPGモデル
• IBIS-AMIモデル
• GDSIIレイアウト
• DRCおよびLVSレポート
• データシート
• SoC統合ガイド
• ドキュメント

Rambus取り扱い製品カテゴリー

IP（IPコア/FPGA/ASIC）

IP（IPコア/FPGA/ASIC）

ソフトウェア

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その他

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