IrDAコントローラ【DIRDA】

概要・特長

DIRDAは、IR受信ダイオードから受信したデータのシリアル-パラレル変換を行います。動作中にいつでもステータスを読み取ることができます。
DIRDAは、タイミング基準となるクロックを1〜128で分割し、内部の受信ロジックを駆動するためのクロックを生成するプログラマブルな内部プリスケーラを備えています。また、コアにはプロセッサ割り込みシステムを搭載しました。これにより、お客様のご要望に応じて割り込みをプログラムすることができ、通信回線の処理に必要な演算を最小限に抑えることができます。また、小型の8ビットSRAM(インターフェース）やAPBスレーブインターフェースを搭載することも可能です。MODE0では、DIRDAはIRフレーム全体のデコード、伝送エラーの検出、キーリリースを行います。MODE1では、内部FIFOが動作し、信号受信時に32シンボルを格納することができます。割り込みトリガレベルレジスタは、1～32シンボルの間で任意の値を設定できます。これらの機能により、NEC、SIRC、TC9012データフォーマットなど、一般的なIRプロトコルの実装に最適な製品となっています。

仕様

• レジスターによるコントローラーの有効化/無効化
• 2つの動作モード
  • MODE0 - 標準的なIRプロトコルのデコーディング
  • MODE1 - 標準または非標準のIRデータフォーマットのシンボル幅検出
• 以下のプロトコル（MODE0）の任意の構成をサポートします。
  • シンプルリピートコード付きNEC
  • フルリピートコード付きNEC
  • TC9012データフォーマット
  • SIRC (SONY)
• マスクされた、またはマスクされていない割り込みをサポート。
  • シンボルオーバーフロー割込み（MODE1)
  • シンボルタイムアウト割り込み (MODE1)
  • シンボル受信割り込み (MODE1)
  • キーリリース割り込み (MODE0)
  • データオーバーフロー割り込み(MODE0)
  • データフレームフォーマットエラー割り込み(MODE0)
  • データ受信割り込み(MODE0)
• レジスタへの書き込みによる割込みフラグのクリア
• 設定可能なリセット
• 設定可能なデータバス幅
• 基準クロック周波数（1MHz～128MHzの範囲で設定可能）

製品構成

対応デバイス、対応OS

ASIC、および、FPGA

ロジックリソース

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提供物

• APIを備えたC言語のソフトウェアドライバー
• シリコン実証済みアーキテクチャ
• VERILOG or VHDLソースコード、または、FPGAネットリスト
• VERILOG テストベンチ
• ドキュメント
• 合成スクリプト
• テクニカルサポート

ライセンス形態

シングルプロジェクトライセンス (ロイヤリティなし)

評価版

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製品カタログ

• IrDAコントローラ【DIRDA】_catalog

Digital Core Design取り扱い製品カテゴリー

IP（IPコア/FPGA/ASIC）

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